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sorthdl作为一个开放的源代码和访问RTL / VHDL / Verilog的排序程序。
sorthdl是inuitive足以倾倒适当的的VHDL库的映射编译脚本。
该软件的目的是为那些设计师,不知道他们的RTL文件的神器出山:www.shenqi73.com顺序,不知道在哪个库文件来编译。
该实用程序将需要的文件,包含了所有的Verilog和/或VHDL文件(每个文件一行,没有任何*或常规中表达的)。它在内部处理所有这些,并最终创建的ModelSim编译脚本。该脚本可以被用来创建编译脚本进行任何
simullator。
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